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启扬IAC-IMX6UL-KIT 开发板时钟配置

发布日期:2021/07/20 08:14:13 发布者:admin

  启扬IAC-IMX6UL-KIT开发板时钟配置

  启扬i.MX6UL开发板时钟由24Mhz与32.768Khz晶振提供,这里不具体介绍NXP公司整体的时钟规划,只从软件API接口方面去分析如何去修改一个外设的时钟。

  接下来的讲解将以CAN总线的时钟为例。

  查看i.MX6UL的数据手册,找到CCM Clock Tree章节,这里具体展示了NXP是如何分配相关外设时钟的。

  从上图中我们能够看到,外设FLEXCAN的时钟主要是由PLL3也就是480Mhz供应,并且由CAN_CLK_SEL寄存器控制分频器的选择,我们可以选择八分频、六分频、OSC,也就意味着可以选择80Mhz、60Mhz、24Mhz(OSC_CLK)的分频器,然后又由CAN_CLK_PODF寄存器选择分频的倍数,由图可知目前默认为2分频,所以我们目标板上的FLEXCAN时钟数要么是40Mhz,要么是30Mhz又或者是12Mhz。

  进入启扬i.MX6UL开发板中,利用IP命令可以查看当前CAN总线的时钟是多少。

  如图所示,可知当前所用开发板的时钟数为30Mhz。

  根据数据手册,如果想要修改FLEXCAN的时钟大小我们只需要修改CAN_CLK_SEL和CAN_CLK_PODF寄存器即可。

  在Datasheet搜索这两个寄存器可以看到配置的详细信息。

  那么从开发板上面看到的30Mhz来看,默认这两个寄存器的值都是0。

  接下来从代码方面查看如何实现相关配置。

  (接下来的实例分析是通过修改分频倍数来修改具体的时钟,也就是CAN_CLK_PODF寄存器的修改)。

  查看iMX6UL CAN控制器的时钟配置相关,如图所示:

  如图所示,该控制器的时钟跟CLK_CAN1_IPG和CLK_CAN1_SERIAL两个寄存器有关。

  在源码中搜索这两个寄存器,可以看到相关的定义。

  内核里通过imx_clk_gate2函数将设备树中的节点信息注册,该函数最终会调用clk_register_gate2函数,clk_register_gate2有clk_gate2_flags变量,该变量又由clk_gate2结构体初始化,在clk_register_gate2中注册为0,所以这里就不再使用can1_serial这个name,而是由CAN_PODF时钟来分配,所以在源码中继续搜索CAN_PODF时钟。

  这里imx_clk_gate2函数主要是用来配置低功耗状态下时钟的选择情况。

  由上图可知内核是通过imx_clk_divider函数将can_podf注册到内核中,跟踪这个函数发现最后调用的是*_register_divider函数,依旧通过clk_divider_flags变量来配置寄存器,而该变量是由结构体clk_divider初始化。初始化该变量为000110(初始化状态不能设置为0),所以flags选择的是1+1=2的分频模式。

  这里实际divider值等于寄存器的值加一,所以当flags设置为0也就是一分频的时候,实际表现出来的是二分频,所以是30Mhz。

  那么如果想要将它设置为60Mhz,我们就可以将该寄存器设置为0,然后加一就是一分频,所以我们需要将flags设置为CLK_DIVIDER_ONE_BASED | CLK_DIVIDER_ALLOW_ZERO,这里flags的意思是允许寄存器为0且设置的值就是divider寄存器的值,这样,就可以把CAN的时钟拉到60Mhz。

  到这里算是修改完毕了,这里提供的是修改分频器的分频系数来修改的,有兴趣的小伙伴也可以修改分频器来修改时钟。

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